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NT256D72S89AKGU 查看數據表（PDF） - Unspecified

零件编号

产品描述 (功能)

生产厂家

NT256D72S89AKGU

256MB : 32M x 72 Low Profile Registered DDR SDRAM DIMM

Unspecified

NT256D72S89AKGU Datasheet PDF : 15 Pages

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NT256D72S89AKGU

256MB : 32M x 72

Low Profile Registered DDR SDRAM DIMM

Functional Block Diagram (1 Bank, 32Mx8 DDR SDRAMs)

RS0

DQS0

DQS9

DQ0

DQ1

DQ2

DQ3

DQ4

DQ5

DQ6

DQ7

DQS1

DQS10

DQ8

DQ9

DQ10

DQ11

DQ12

DQ13

DQ14

DQ15

DQS2

DQS11

DQ16

DQ17

DQ18

DQ19

DQ20

DQ21

DQ22

DQ23

DQS3

DQS12

DQ24

DQ25

DQ26

DQ27

DQ28

DQ29

DQ30

DQ31

DQS8

DQS17

CB0

CB1

CB2

CB3

CB4

CB5

CB6

CB7

I/O 7

I/O 6

I/O 1

I/O 0

I/O 5

I/O 4

I/O 3

I/O 2

CS DQS

I/O 7

I/O 6

I/O 1

I/O 0

I/O 5

I/O 4

I/O 3

I/O 2

CS DQS

I/O 7

I/O 6

I/O 1

I/O 0

I/O 5

I/O 4

I/O 3

I/O 2

CS DQS

I/O 7

I/O 6

I/O 1

I/O 0

I/O 5

I/O 4

I/O 3

I/O 2

CS DQS

I/O 7

I/O 6

I/O 1

I/O 0

I/O 5

I/O 4

I/O 3

I/O 2

CS DQS

DQS4

DQS13

DQ32

DQ33

DQ34

DQ35

DQ36

DQ37

DQ38

DQ39

DQS5

DQS14

DQ40

DQ41

DQ42

DQ43

DQ44

DQ45

DQ46

DQ47

DQS6

DQS15

DQ48

DQ49

DQ50

DQ51

DQ52

DQ53

DQ54

DQ55

DQS7

DQS16

DQ56

DQ57

DQ58

DQ59

DQ60

DQ61

DQ62

DQ63

DM CS DQS

I/O 7

I/O 6

I/O 1

I/O 0 D4

I/O 5

I/O 4

I/O 3

I/O 2

DM CS DQS

I/O 7

I/O 6

I/O 1

I/O 0 D5

I/O 5

I/O 4

I/O 3

I/O 2

DM CS DQS

I/O 7

I/O 6

I/O 1

I/O 0 D6

I/O 5

I/O 4

I/O 3

I/O 2

DM CS DQS

I/O 7

I/O 6

I/O 1

I/O 0 D7

I/O 5

I/O 4

I/O 3

I/O 2

BA0-BA1

A0-A12

RAS

CAS

CKE0

R RS0

E RBA0-RBA1

G RA0-RA12

RRAS

T RCAS

E RCKE0

R RWE

CS : SDRAMs D0-D8

BA0-BA1 : SDRAMs D0-D8

A0-A12 : SDRAMs D0-D8

RAS : SDRAMs D0-D8

CAS : SDRAMs D0-D8

CKE : SDRAMs D0-D8

WE : SDRAMs D0-D8

PCK

RESET

Notes :

1. DQ-to-I/O wiring may be changed within a byte.

2. DQ/DQS/DM/CKE/CS relationships are maintained as shown.

3. DQ/DQS resistors are 22 Ohms.

4. VDDID strap connections (for memory device VDD,VDDQ):

STRAP OUT (OPEN): VDD = VDDQ

STRAP IN (VSS): VDD is not equal to VDDQ

5. Address and control resistors are 22 Ohms.

VDDSPD

VDDQ

VDD

VREF

VSS

VDDID

Serial PD

D0-D8

Strap : see Note 4

Serial PD

SCL

WP A0 A1 A2

SA0 SA1 SA2

SDA

CK0, CK0 --------- PLL*

* Wire per Clock Loading Table/Wiring Diagrams

REV 0.2 (Preliminary)

09/2002

NANYA TECHNOLOGY CORP. reserves the right to change Products and Specifications without notice.

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